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感存算芯片F(xiàn)PGA仿真驗證板 (****) 采購公告
發(fā)布時間：2024-10-16 15:50:20
| 感存算芯片F(xiàn)PGA仿真驗證板 | 項目編號**** | |
| 2024-10-16 15:50:20 | 公告截止日期2024-10-20 12:00:00 | |
| **** | 付款方式貨到安裝、調(diào)試、驗收合格后，付全款。 | |
| 發(fā)布競價結(jié)果后7天內(nèi)簽訂合同 | 到貨時間要求發(fā)布競價結(jié)果后7天內(nèi)送達 | |
| 幣種 | 人民幣 | |
| **省**市**區(qū)**** | ||
| 無 | ||
采購清單 1
| 感存算芯片F(xiàn)PGA仿真驗證板 | 8.00 | 塊 | 無 |
| 不限 |
| 不限 |
| 1.硬件系統(tǒng)基本要求 1.1. 芯片采用Xilinx Ultrascale+ XCVU13P FPGA； 1.2. 系統(tǒng)邏輯**3780K； 1.3. 系統(tǒng)滿足設(shè)計容量2280萬ASIC門的設(shè)計和驗證容量； 1.4. 靈活擴展接口，兼容業(yè)界主流功能性接口擴展方式，可以按照獨立Bank進行電壓配置，適用多場景應(yīng)用SoC； 1.5. 提供在線系統(tǒng)健康監(jiān)視與控制BMC（包含支持多用戶注冊、管理員權(quán)限、支持電壓檢測）； 2.硬件** 2.1. 不低于72 lanes的高速GTY通道； 2.2. 支持45路以上LVDS差分對，可用單端IO數(shù)量不少于610個； 2.3. 可外接不低于3組的DDR3/4； 2.4. 支持虛擬管腳； 2.5. 不少于4路可編程時鐘，時鐘頻率范圍2-350MHz； 2.6. 至少提供1路ZCLK共享全局可編程差分時鐘； 3.配套軟件 3.1. 支持運行環(huán)境配置軟件 3.1.1.系統(tǒng)可通過以太網(wǎng)、USB、SD卡、JTAG方式配置； 3.1.2.支持子卡掃描校準，支持一鍵生成管腳約束； 3.1.3.支持套件和通信加密以及硬件自檢測試； 3.1.4.支持系統(tǒng)互聯(lián)狀態(tài)自動診斷及校準； 3.1.5.支持快速配置時鐘、Bank電壓及位流文件； 3.1.6.支持系統(tǒng)遠程監(jiān)測與管理； 3.1.7.支持自動Socket Binding； 3.2. 支持硬件仿真加速器HyperSemu 3.3. 提供專用RISC-V驗證工具鏈 3.3.1.支持工具自動生成單核RISC-V，雙核RISC-V，四核RISC-V當(dāng)多核SOC， 3.3.2.支持工具自動生成基于主流RTL仿真器的RISC-V仿真腳本與仿真環(huán)境； 3.3.3.支持工具自動生成原型驗證板的FPGA原型環(huán)境； 3.3.4.提供基于RISC-V的虛擬磁盤、虛擬網(wǎng)絡(luò)外設(shè)，用戶可驗證訪問虛擬文件存儲和虛擬網(wǎng)絡(luò)設(shè)備； 3.3.5.提供基于RISC-V的虛擬UART，可打印輸入字符，驗證相關(guān)通路； |
| 1.產(chǎn)品支持：產(chǎn)品到貨之日起一年內(nèi)電話、現(xiàn)場和電子郵件遠程技術(shù)支持及后續(xù)升級費用。 2.產(chǎn)品保修：產(chǎn)品自發(fā)貨之日起兩年內(nèi)保修，人為故障除外，維修通過郵寄進行，其中FPGA芯片在接收貨品后兩周內(nèi)保換。 |
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2024-10-16
招標公告
感存算芯片F(xiàn)PGA仿真驗證板 (XJD2024101600021) 采購公告
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